一.    引言

   
     隨著科學(xué)技術(shù)的發(fā)展，電子產(chǎn)品的更新?lián)Q代進(jìn)一步加快，現(xiàn)代電子設(shè)計技術(shù)已進(jìn)入一個全新的階段。20世紀(jì)90年代是可編程邏輯器件和EDA技術(shù)發(fā)展最快的時期，電子設(shè)計的自動化程度越來越高，傳統(tǒng)的電子設(shè)計方法、工具和器件在更大的程度上被EDA所取代。在EDA技術(shù)中，最為矚目的是以現(xiàn)代電子技術(shù)為特征的邏輯設(shè)計仿真測試技術(shù)。這種技術(shù)的出現(xiàn)，使電子系統(tǒng)設(shè)計發(fā)生了質(zhì)的變化。本文結(jié)合EDA技術(shù)及當(dāng)今流行的VHDL硬件描述語言，并通過ispDesignExpert開發(fā)系統(tǒng)進(jìn)行仿真。設(shè)計的數(shù)字鐘應(yīng)用模塊設(shè)計方法，通過“自頂向下”的設(shè)計思路，實現(xiàn)數(shù)字鐘的預(yù)置功能，并可顯示年月日時分秒。

二．EDA、VHDL及ispDesignExpert開發(fā)系統(tǒng)簡介

    EDA技術(shù)是從計算機(jī)輔助設(shè)計CAD、計算機(jī)輔助制造CAM、計算機(jī)輔

助測試CAT和計算機(jī)輔助工程CAE等技術(shù)發(fā)展而來的。它以計算機(jī)為工具，設(shè)計者只需對系統(tǒng)功能進(jìn)行描述，就可在EDA工具的幫助下完成系統(tǒng)設(shè)計。EDA技術(shù)為電子產(chǎn)品的設(shè)計和開發(fā)縮短了時間，降低了成本，提高了系統(tǒng)的可靠性。
    VHDL硬件描述語言的英文全名是Very HighSpeed Integrated Ciruit

Hardware Description Language,即超高速集成電路硬件描述語言。VHDL語言描述能力強(qiáng)，特別適合數(shù)字電子系統(tǒng)的設(shè)計。VHDL語言語法規(guī)范，可讀性好。這也是VHDL語言得到廣泛應(yīng)用的重要原因。一個VHDL語言程序可由實體(Entity)說明、結(jié)構(gòu)體（Architecture）、程序包(Package)、庫(Library) 、配置(Configuration)5個部分組成。其中庫、實體說明、結(jié)構(gòu)體是一個VHDL語言程序的基本組成部分。VHDL語言程序結(jié)構(gòu)示意如下圖所示。

                                                         圖一   VHDL語言程序結(jié)構(gòu)示意圖

    ispDesignExpert開發(fā)系統(tǒng)具有用戶界面友好，功能強(qiáng)大，使用方便易學(xué)易用。它有以下特征：
（1）設(shè)計輸入方式：支持Schematic輸入、 ABEL-HDL輸入、VHDL輸入、Verilog-   HDL輸入多種輸入方式。
（2）設(shè)計驗證：支持功能仿真、時序仿真、靜態(tài)時序分析多種驗證方式。
（3）編譯器：能夠自動完成邏輯綜合、映射、自動布局和布線，并提供約束管理器便于用戶對器件進(jìn)行優(yōu)化約束設(shè)定。

三．?dāng)?shù)字鐘的設(shè)計實現(xiàn)

    本設(shè)計要實現(xiàn)一個具有帶預(yù)置數(shù)的數(shù)字鐘的設(shè)計，它具備顯示年月時分秒功能。工作說明：使用前預(yù)置時間。一般情況下，6個數(shù)字顯示器將顯示十分秒，SET按鈕產(chǎn)生第一個脈沖時，顯示切換為年月日。第二個脈沖到來時，可預(yù)置年份；第三個脈沖到來時，可預(yù)置月份。依次第四、五、六、七個脈沖到來時分別可預(yù)置日期、時、分、秒，第八個脈沖到來后預(yù)置結(jié)束，正常工作，顯示的是時分秒。UP為高時，UPCLK有脈沖到達(dá)時，預(yù)置位加一，否則減一。
    采用硬件描述語言輸入，其VHDL整體源文件描述程序從略，只對其進(jìn)行簡單說明：最頂層模塊是TIMEKEEPER，它包括5個子模塊，它們分別是：u1:second_wave,u2:h_m_s_time,u3:date,u4:month_year,u5:led_disp。模塊second_wave產(chǎn)生1Hz脈沖。模塊h_m_s_time是時分秒模塊，完成時分秒的預(yù)置與計時。當(dāng)計時滿24小時時，引腳產(chǎn)生進(jìn)位。模塊date是日期模塊，完成日期的預(yù)置與顯示。模塊month_year是年月份模塊,完成年月的預(yù)置與顯示。模塊led_disp是顯示模塊，完成顯示的切換。預(yù)置年份時，其他LED顯示為FF，預(yù)置月份時，其他LED顯示為FF，依次類推。仿真結(jié)果如下：

                                               圖三          時間波形圖

四．結(jié)束語

    隨著電子設(shè)計自動化EDA技術(shù)的進(jìn)步和軟件開發(fā)系統(tǒng)的日趨完善，利用

EDA工具，電子設(shè)計師可以從概念、算法、協(xié)議等開始設(shè)計電子系統(tǒng)。在機(jī)械、電子、通信、航空航天、化工、礦產(chǎn)、生物、醫(yī)學(xué)、軍事等各個領(lǐng)域，都有EDA的應(yīng)用。應(yīng)用它所設(shè)計的電路和系統(tǒng)的硬件結(jié)構(gòu)及其功能均可借用目前廣泛使用的VHDL硬件描述語言設(shè)計輸入，它能夠顯著增強(qiáng)設(shè)計的靈活性，提高產(chǎn)品性能，減輕設(shè)計的工作量，縮短設(shè)計周期，更為設(shè)計復(fù)雜數(shù)字系統(tǒng)提供了高效的工具。

參考文獻(xiàn)

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4.Kevin Skahill.可編程邏輯系統(tǒng)的VHDL技術(shù).東南大學(xué)出版社,1998.